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嵌入式培訓

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集成電路設(shè)計中心企業(yè)

  
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  　　　　　　　　　　 　集成電路（IC）版圖設(shè)計工程師培訓班
   課程目標
        IC設(shè)計培訓課程可以讓學員深入了解復(fù)雜芯片的基本模塊建立，了解后端的芯片Layout過程以及影響芯片性能的各種因數(shù)，掌握如何提高整個芯片設(shè)計的成功率和高性能，能夠獨立完成各個流程的設(shè)計，并大幅度提高個人在IC設(shè)計各個環(huán)節(jié)中的設(shè)計能力。

主要內(nèi)容：
集成電路設(shè)計流程及IC版圖設(shè)計
總體設(shè)計及布局規(guī)劃
各種電路的版圖實現(xiàn)證
版圖設(shè)計中各種技巧
  培養(yǎng)對象
        專注于IC設(shè)計領(lǐng)域的人和希望了解整個IC設(shè)計流程的工程師，即將介入IC 設(shè)計領(lǐng)域的畢業(yè)生，即將轉(zhuǎn)為從事半導體工作的人員,已經(jīng)從事IC設(shè)計，如概念工程師，設(shè)計工程師，布線工程師，測試工程師,應(yīng)用工程師，IC芯片設(shè)計項目經(jīng)理。
   入學要求

        學員學習本課程應(yīng)具備下列基礎(chǔ)知識：
        ◆電路系統(tǒng)的基本概念。
   班級規(guī)模及環(huán)境
       為了保證培訓效果，增加互動環(huán)節(jié)，我們堅持小班授課，每期報名人數(shù)限20人，多余人員安排到下一期進行。
   上課時間和地點
上課地點：【上海】：同濟大學(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】：北京中山/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領(lǐng)館區(qū)1號（中和大道） 【沈陽分部】：沈陽理工大學/六宅臻品 【鄭州分部】：鄭州大學/錦華大廈 【石家莊分部】：河北科技大學/瑞景大廈
近開課時間(周末班/連續(xù)班/晚班）：集成電路版圖設(shè)計初級班：2025年5月19日....--即將開課--........................(歡迎您垂詢，視教育質(zhì)量為生命！)
   學時
　    ◆課時： 共4天,24學時

        ◆外地學員：代理安排食宿（需提前預(yù)定） ☆注重質(zhì)量 ☆邊講邊練
        ☆合格學員免費推薦工作
        ★實驗設(shè)備請點擊這兒查看★
   新優(yōu)惠
       ◆團體報名優(yōu)惠措施：兩人95折優(yōu)惠，三人或三人以上9折優(yōu)惠 。注意：在讀學生憑學生證，即使一個人也優(yōu)惠500元。
   質(zhì)量保障

        1、培訓過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、培訓結(jié)束后免費提供一個月的技術(shù)支持，充分保證培訓后出效果；
        3、培訓合格學員可享受免費推薦就業(yè)機會。
  　　　　　 集成電路（IC）版圖設(shè)計培訓班
  課程進度安排
課程大綱

 

 

課程進度安排  
時間 課程大綱  
第一階段  
學習目標 掌握Linux基本操作，vi編輯器的使用，virtuoso軟件的操作。  
  1 Linux的用戶界面及工作站的登陸。

1.1 Linux概述
1.2 Linux系統(tǒng)訪問
1.3 Linux的圖形用戶界面
1.4 Linux的文件和目錄
1.5 文本編輯器Vi

實驗：，訪問相關(guān)目錄和文件，編輯文件。
  
  2 virtuoso軟件的啟動

2.1 virtuoso軟件的配置文件cds.lib
2.2 icfb的啟動：icfb
2.3 版圖建庫的文件display.drf
實驗:編輯 cds.lib文件。
啟動icfb,建立一個layout 庫，刪除一個庫。

3 virtuoso軟件的操作

3.1 快捷的默認設(shè)置。
3.2 快捷的個人設(shè)置，怎么修改快捷鍵。
3.3 繪制Path、Rectangle

實驗:編輯.bashrc 文件。
使用快捷鍵繪制Path、Rectangle，添加圖形。
  
 

4.
4.1 IC設(shè)計流程及
4.2 IC版圖設(shè)計的作用
4.3 平面半導體工藝和術(shù)語
4.4 CMOS基本工藝
4.5 NMOS/PMOS/NPN/PNP 及其版圖實現(xiàn)
4.6 反相器的版圖實現(xiàn)
4.7 版圖設(shè)計環(huán)境及工具的使用
4.8 版圖編輯的快捷鍵
第二階段  
學習目標 了解IC版圖的基本概念，半導體的工藝流程，學會做版圖的基本器件。  
  5 半導體基礎(chǔ)理論、集成電路制造工藝

5.1 PN結(jié)
5.2 介紹
5.3 MOS場效應(yīng)晶體管
5.4 集成電路中的器件結(jié)構(gòu)


6 集成電路設(shè)計概述

6.1 集成電路設(shè)計流程和設(shè)計工具
6.2 國內(nèi)外集成電路技術(shù)發(fā)展概況
6.3 國內(nèi)外主要集成電路晶圓代工廠(Foundry)介紹
  
  6 半導體器件原理及版圖設(shè)計

6.1 Design Rule的基本概念及內(nèi)容。
6.2 MOS管的版圖設(shè)計及剖面圖。
6.3 反相器（invter）的結(jié)構(gòu)及版圖設(shè)計

7 反相器及其版圖實現(xiàn)


實驗：
1. 做一個nmos管實驗
2. 做一個pmos管實驗
3, 做一個NPN管實驗
4，做一個PNP管實驗
 
   
第三階段  
學習目標 學會版圖設(shè)計的重要技巧  
  8 Cell的概念和練習

8.1 Cell的基本概念。
8.2 Controll Cell。
8.4 CELL制作技巧。

實驗：做一個Controll Cell模塊實驗。
  
  9 pkchip制作實戰(zhàn) 。

9.1 chip 規(guī)劃.
9.2 電源的配置及操作。
9.3 地的配置和操作。
9.4 Inverse的放置。

10 pkchip制作技巧總結(jié)


實驗：
pkchip制作實戰(zhàn)演練。
  
   
第四階段  
學習目標 掌握做一個OPAMP的版圖設(shè)計  
  11 IC layout模擬模塊設(shè)計

11.1 OPAMP的原理及版圖設(shè)計
11.2 概念及版圖設(shè)計
11.3 技巧總結(jié)

 
  12.
12.1 對稱的概念及版圖設(shè)計
12.2 不同器件特性相對版圖布局的關(guān)系
12.3 關(guān)鍵線的連接
12.4 電源和地線的連接

實 驗：完成OP版圖
  

 
 
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.(2014年7月11)......................................................................
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